L'étape finale du processus de conception des puces, appelée « tapeout », est un processus rigoureux et coûteux qui laisse peu de place aux erreurs de conception. Si une conception échoue après le tapeout, les fabricants de puces doivent relancer un nouveau cycle de « re-spin » qui peut durer 12 mois, voire plus. Le retard causé par cette refonte nécessite non seulement des ressources de recherche et développement supplémentaires et coûteuses, mais peut également empêcher les fabricants de commercialiser leurs produits à temps.
Keysight Technologies propose une large gamme de solutions de mesure et de test.
La plateforme Keysight USPA fournit aux concepteurs et ingénieurs de puces un jumeau numérique complet de signaux pour vérifier les conceptions avant de passer à la fabrication, minimisant ainsi les risques d'erreurs de conception et les coûts de reconception. La plateforme USPA intègre des convertisseurs de signaux ultra-rapides à un système de prototypage FPGA hautes performances, offrant aux concepteurs une alternative aux systèmes de prototypage propriétaires et personnalisés.
En outre, la solution fournit également des interfaces d'entrée/sortie adaptées aux applications telles que le développement d'applications radio 6G, la mémoire de radiofréquence numérique, la recherche en physique avancée et les applications d'acquisition de données à grande vitesse, telles que le radar et la radioastronomie.
« La plateforme USPA de Keysight accélère et minimise les risques liés au développement de puces, offrant une solution innovante qui répond aux défis des conceptions de pointe dans des environnements coûteux », a déclaré le Dr Joachim Peerlings, vice-président et directeur général du groupe Solutions Réseau et Centre de Données de Keysight. « Cette plateforme performante offre aux développeurs de puces un jumeau numérique de leur futur silicium, leur permettant de valider pleinement les conceptions et les algorithmes, minimisant ainsi les risques et les coûts associés aux reconceptions. »
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